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<紀要>送信機閉回路の設計図表
https://doi.org/10.57375/00001737
https://doi.org/10.57375/00001737190e3ff2-561a-4f78-a630-e975b30be311
| 名前 / ファイル | ライセンス | アクション |
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KJ00000147340.pdf (298.4 kB)
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| Item type | 紀要論文 / Departmental Bulletin Paper(1) | |||||
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| 公開日 | 2009-04-10 | |||||
| タイトル | ||||||
| タイトル | <紀要>送信機閉回路の設計図表 | |||||
| タイトル | ||||||
| タイトル | The Computation Diagram for plauning the Transmitter Closed Circuits | |||||
| 言語 | en | |||||
| 言語 | ||||||
| 言語 | jpn | |||||
| 資源タイプ | ||||||
| 資源タイプ識別子 | http://purl.org/coar/resource_type/c_6501 | |||||
| 資源タイプ | departmental bulletin paper | |||||
| ID登録 | ||||||
| ID登録 | 10.57375/00001737 | |||||
| ID登録タイプ | JaLC | |||||
| 著者 |
波々伯部, ?
× 波々伯部, ?× HOOKABE, Sunao |
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| 書誌情報 |
福井工業大学研究紀要 号 2, p. 123-129, 発行日 1972-07-20 |
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| 出版者 | ||||||
| 出版者 | 福井工業大学 | |||||
| ISSN | ||||||
| 収録物識別子タイプ | ISSN | |||||
| 収録物識別子 | 2868571 | |||||
| 書誌レコードID | ||||||
| 識別子タイプ | NCID | |||||
| 関連識別子 | TF00011796 | |||||
| 著者版フラグ | ||||||
| 出版タイプ | VoR | |||||
| 出版タイプResource | http://purl.org/coar/version/c_970fb48d4fbd8a85 | |||||
